Clestek · 电子元器件型号库
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是高性能CMOS（电可擦除）可编程逻辑器件（PLD），采用经过验证的电可擦除闪存技术。提供低至5ns的速度和低至10μA（典型值）的功耗。所有速度范围均在工业温度范围的5V±10%范围内以及商业温度范围的5V±5%范围内指定。有几种低功耗选项，可针对各种类型的功率受限应用选择最佳解决方案，能显著降低系统总功率并提高系统可靠性。
XC9536XL 是一款针对领先通信和计算系统中高性能、低电压应用的3.3V CPLD。它由两个54V18功能块组成，提供800个可用门，传播延迟为5纳秒。
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是一种高性能、高密度的复杂可编程逻辑器件 (CPLD)，采用了经过验证的电可擦除存储技术。拥有64个逻辑宏单元和多达68个输入，可轻松集成来自多个TTL、SSI、MSI、LSI和传统PLD的逻辑。增强的路由开关矩阵增加了可用门数和成功进行引脚锁定设计修改的几率。 拥有多达68个双向I/O引脚和4个专用输入引脚，具体取决于所选的器件封装类型。每个专用引脚还可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元内单独选择使用
逻辑芯片 FPGA CYCLONE SMD 逻辑块数: 291 宏单元数: 2910 总比特数: 59904 输入/输出数: 104 内核供电电压最小值: 1.425V 内核供电电压最大值: 1.575V 输入/输出电源电压: 3.3V 最高工作频率: 275MHz MSL: MSL 3 - 168小时 工作温度最小值: 0°C 工作温度最高值: 85°C 工作温度范围: 0°C 至 +85°C 核心供电电压: 1.425V 至 1.575V 电源电压最大值: 1.575V 电源电压最小值: 1.425V 芯片温度范围: 商用 输入/输出接口标准: LVCMOS, LVDS, LVTTL, PCI, SSTL-2, SSTL-3 逻辑芯片功能: FPGA 逻辑芯片基本号: 1 频率: 275MHz
iCE40 Ultra系列是一种超低功耗的FPGA和传感器管理器，专为超低功耗移动应用设计，如智能手机、平板电脑和手持设备。iCE40 Ultra系列集成了SPI和I2C模块，可与几乎所有移动传感器和应用处理器接口。iCE40 Ultra系列还具有两个片上振荡器，分别为10 kHz和48 MHz。LFOSC（10 kHz）非常适合始终开启应用中的低功耗功能，而HFOSC（48 MHz）可用于唤醒活动。iCE40 Ultra系列还具有DSP功能块，可以卸载应用处理器来预处理来自移动传感器的信息。内置的RGB PWM IP，结合iCE40 Ultra上的三个24 mA恒流RGB输出，提供了直接驱动服务LED所需的所有逻辑，无需外部MOSFET或缓冲器。500 mA恒流IR驱动输出提供与外部LED的直接接口，适用于如IrDA功能等应用。用户只需实现符合其需求的调制逻辑，并将IR驱动直接连接到LED，无需外部MOSFET或缓冲器。这种高电流IR驱动也可用于条形码仿真，向外部条形码读取器发送条形码信息。iCE40 Ultra系列具有三种器件密度，从1100到3520个查找表（LUT）的逻辑，带有可编程I/O，可用作SPI/I2C接口端口或通用I/O。它还具有高达80 kbits的块RAM，以配合用户逻辑使用。
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该产品是一款高性能CMOS（电可擦除）可编程逻辑器件（PLD），采用成熟的电可擦除技术。它采用44引脚表面贴装封装，具有全连接逻辑阵列和灵活的宏单元结构，可实现高门利用率。所有引脚和反馈项始终可供每个宏单元使用。每个和项输入四个乘积项，每个宏单元的三个和项可组合，每个和项最多可提供12个乘积项且不影响性能。每个触发器可单独选择为D型或T型，24个触发器可旁路以提供内部组合反馈。乘积项为每个触发器提供单独的时钟和异步复位，触发器也可配置为直接输入引脚时钟。每个输出都有自己的使能乘积项，八个同步预设乘积项服务于四个或八个触发器的本地组，提供寄存器预加载功能，所有寄存器在上电时自动复位。
LatticeECP3（经济型增强第三代）系列FPGA器件针对高性能特性进行了优化，如增强的DSP架构、高速SERDES和高速源同步接口，在经济型FPGA结构中实现了这些特性。这种组合通过设备架构的进步和65纳米技术的应用得以实现，使该系列器件适用于大批量、高速度、低成本的应用。LatticeECP3系列扩展了查找表（LUT）容量至149K逻辑单元，并支持多达586个用户I/O。LatticeECP3系列还提供最多320个18 X 18乘法器和广泛的并行I/O标准。LatticeECP3 FPGA结构在设计时考虑到了高性能和低成本。LatticeECP3器件利用可重构的SRAM逻辑技术，提供了诸如基于LUT的逻辑、分布式和嵌入式存储器、锁相环（PLL）、延迟锁定环（DLL）、预工程化的源同步I/O支持、增强的sysDSP切片以及高级配置支持等功能，包括加密和双启动功能。LatticeECP3系列中实现的预工程化源同步逻辑支持广泛接口标准，包括DDR3、XGMII和7:1 LVDS。LatticeECP3系列还具有带专用PCS功能的高速SERDES。高抖动容限和低传输抖动使得SERDES加上PCS模块可以配置以支持一系列流行的数据协议，包括PCI EXpress、SMPTE、以太网（XAUI、GbE和SGMII）以及CPRI。发送预加重和接收均衡设置使SERDES适合于通过各种介质进行传输和接收。LatticeECP3器件还提供了灵活、可靠和安全的配置选项，例如双启动功能、位流加密和TransFR现场升级功能。Lattice Diamond 和 ispLEVER 设计软件允许使用LatticeECP3 FPGA系列高效地实现大型复杂设计。为流行的逻辑综合工具提供了对LatticeECP3的支持库。Diamond和ispLEVER工具利用综合工具输出及布局规划工具中的约束条件来在LatticeECP3器件中放置和布线设计。工具从布线中提取时序信息，并将其反馈到设计中进行时序验证。Lattice为LatticeECP3系列提供了许多预先设计好的IP（知识产权）模块。通过将这些可配置的软核IP作为标准化块使用，设计人员可以专注于其设计的独特方面，从而提高生产效率。
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特性：最低功耗FPGA。 设计安全特性。 增加系统集成。 逻辑单元和逻辑阵列块
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FPGA针对低成本和低静态功耗进行了优化，非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O，满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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XP2器件将基于查找表（LUT）的FPGA结构与非易失性Flash单元相结合，形成一种称为flexiFLASH的架构。flexiFLASH方法提供的优势包括即时启动、无限可重新配置性、带有FlashBAK嵌入式块存储器的片上存储和串行TAG存储器以及设计安全性。这些器件还支持带有TransFR的Live Update技术、128位AES加密和双启动技术。 XP2 FPGA结构从一开始就针对这项新技术进行了优化，兼顾高性能和低成本。 XP2器件包括基于LUT的逻辑、分布式和嵌入式存储器、锁相环（PLL）、预先设计的源同步I/O支持以及增强的sysDSP块。 Diamond 设计软件允许使用 XP2系列FPGA器件高效地实现大型和复杂的设计。 XP2提供适用于常用逻辑综合工具的综合库支持。Diamond软件使用综合工具的输出以及其布局规划工具的约束来在 XP2器件中放置和布线设计。Diamond工具从布线中提取时序，并将其回注到设计中进行时序验证。 为 XP2系列提供许多预先设计的知识产权（IP） CORE模块。通过使用这些IP作为标准化块，设计人员可以专注于设计的独特方面，从而提高他们的生产力。
Spartan -7 FPGAs有 -2、 -1和 -1L速度等级,其中 -2具有最高性能。Spartan -7 FPGAs主要在1.0V核心电压下运行。 -1L器件经过筛选,具有较低的最大静态功率,与 -1器件相比,可在较低的核心电压下运行以降低动态功率。 -1L器件仅在VCCINT = VCCBRAM = 0.95V下运行,并且具有与 -1速度等级相同的速度规格
第三代闪存FPGA提供超越ProASIC Plus系列的性能、密度和特性。非易失性闪存技术使设备成为安全、低功耗、单芯片解决方案，可即时启动。可重新编程，以ASIC级单位成本提供上市时间优势。这些特性使设计人员能够使用现有的ASIC或FPGA设计流程和工具创建高密度系统
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Spartan -7 FPGAs有 -2、 -1和 -1L速度等级,其中 -2具有最高性能。Spartan -7 FPGAs主要在1.0V核心电压下运行。 -1L器件经过筛选,具有较低的最大静态功率,与 -1器件相比,可在较低的核心电压下运行以降低动态功率。 -1L器件仅在VCCINT = VCCBRAM = 0.95V下运行,并且具有与 -1速度等级相同的速度规格
Field-Programmable Gate Arrays (FPGAs) 专为满足高容量、对成本敏感的消费电子应用需求而设计。该系列有五种型号，系统门密度从100,000到160万不等。Spartan-3E系列基于早期Spartan-3系列的成功经验，增加了每个I/O的逻辑量，显著降低了每个逻辑单元的成本。新特性提高了系统性能并降低了配置成本
我们可以协助查找停产料替代方案，也可以按功能参数反向选型。