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SN74HC139-Q1 汽车类二路 2 线路至 4 线路解码器/解复用器

是高速硅栅CMOS器件，与低功耗肖特基TTL (LSTTL)引脚兼容，符合JEDEC标准No. 7A。是3至8线解码器/解复用器，接受三个二进制加权地址输入 (A0、A1和A2)，启用时提供八个互斥输出 (Y0至Y7)，选择时为低电平。有三个使能输入：两个低电平有效 (E1和E2) 和一个高电平有效 (E3)。除非E1和E2为低电平且E3为高电平，否则每个输出都为高电平

SN74HC257 具有三态输出的四通道 2 线至 1 线数据选择器/多路复用器

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TS5USBC400 是一种双向低功耗双端口高速USB 2.0模拟开关，具有针对USB Type-C系统的集成保护功能。该器件配置为双路2:1 或1:2 开关，并经过了优化，能够应对USB Type-C系统中的USB 2.0 D+/- 线路。TS5USBC400 在I/O 引脚上的保护功能可承受高达16V 的电压，并配备自动关闭电路来保护开关后面的系统组件。TS5USBC400 采用小型12 引脚DSBGA 封装，使其成为移动应用和空间受限型应用中的杂音问题。中对于高效率、高电源密度和稳健性的需求。

SN74CBT16245C 具有 –2V 下冲保护和两个控制输入的 5V、1:1 (SPST)、16 通道 FET 总线开关

FUSB251 是一款 I2C 控制过电压保护开关，位于 Type?C 接口端口中的 CC 和 SBU 引脚上 。该器件在 CC1/2 和 SBU1/2 上具有 SPST 开关，对于有效的 VDD 将自动启用，以便 Type?C PD 控制器可以使用过电压保护的 CC 路径。FUSB251 具有无电电池模式和带 Rd 的 CC 下拉，因此源器件可以提供用于电池充电的 Vbus。FUSB251 的另一个功能是带 ADC 检测的 CC 和 SBU 路径上的水分检测。一旦检测到水分，则产生中断信号，相应的寄存器进行更新，通知主机。该器件具有片上 IEC 保护，带有 CC 和 SBU 路径上的电涌保护。 CC 和 SBU 端口均为 20 V DC 耐压。

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SN74CBTD16210 具有电平转换器和 2 个控制输入的 5V、1:1 (SPST)、20 通道 FET 总线开关

SN54S151 数据选择器/多路复用器

单缓冲器设计用于2V至5.5V VCC操作。单线路驱动器具有三态输出。当输出使能输入为低电平时，输出被禁用。该器件针对使用loff的部分掉电应用进行了全面规格设计。loff电路可禁用输出，防止在器件掉电时通过器件产生损坏性电流回流。为确保在电源开启或关闭期间处于高阻抗状态，OE应通过下拉电阻连接到GND，电阻的最小值由驱动器的电流源能力决定。该器件采用绿色SOT23-5和SC70-5封装。其工作环境温度范围为-40℃至 + 125℃。

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高速 CMOS 反相输出的 8 位译码器

TP74LVC1G18 是一款具有三态输出的 2 选 1 非反相解复用器。当选择输入 S 为低电平时，数据从 A（输入）传输至 Y0（输出），Y1（输出）处于高阻态。当选择输入 S 为高电平时，数据从 A（输入）传输至 Y1（输出），Y0（输出）处于高阻态

74HC138 是一款高速CMOS 反相输出的8 位译码器。可接受3 位二进制加权地位（A、B、C）输入，实现8 位并行输出;带有一个高有效的使能端（G1）和2 个低有效的使能端（G2A(overline)、G2B(overline)），可以实现多级芯片并行扩展输出。 任选一个低有效使能输入端作为数据输入，而把其余的使能输入端作为选通端，则74HC138 亦可充当一个8 输出多路分配器。

74AHC/AHCT157 是高速硅栅 CMOS 器件，引脚与低功耗肖特基 TTL（LSTTL）兼容。它们符合 JEDEC 标准第 7A 号规范。74AHC/AHCT157 是四 2 输入多路复用器，可在公共数据选择输入（S）的控制下从两个数据源中选择 4 位数据

74HC138的引脚排列与LS138相同。该器件的输入与标准CMOS输出兼容；通过上拉电阻，也可与LSTTL输出兼容。HC138A可将三位地址解码为八路低电平有效输出之一

该器件引脚与 LS138 相同。设备输入与标准 CMOS 输出兼容；通过上拉电阻，它们与 LSTTL 输出兼容。该器件将三位地址解码为八个低电平有效输出之一。此设备具有三个芯片选择输入，两个低电平有效和一个高电平有效，以实现解复用、级联和芯片选择功能。解复用功能通过使用地址输入选择所需的设备输出完成；其中一个芯片选择用作数据输入，而其他芯片选择保持其有效状态。

双路 2 线路至 4 线路解码器/多路解复用器

74HC139A的引脚排列与LS139相同。该器件的输入与标准CMOS输出兼容；通过上拉电阻，也可与LSTTL输出兼容。此器件包含两个独立的1线-4线解码器，每个解码器可将两位地址解码为四个低电平有效输出中的一个