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单正边沿触发D型触发器。D输入的数据在时钟从低到高转换时满足建立和保持时间要求，将被存储在触发器中，其反码将出现在Q输出端。输入可以由3.3V或5V设备驱动，此特性允许这些设备在混合3.3V和5V环境中用作转换器。所有输入的施密特触发器动作使电路能够容忍较慢的输入上升和下降时间。该器件针对使用I_OFF的部分掉电应用进行了全面规定。I_OFF电路可禁用输出，防止器件掉电时通过器件产生潜在的破坏性回流电流。

TC74HC74A是一款采用硅栅C²MOS技术制造的高速CMOS D触发器。它在保持CMOS低功耗特性的同时，能实现与等效LSTTL类似的高速运行。在时钟脉冲的上升沿期间，施加到D输入端的信号电平会传输到Q输出端

SN74LS112A 具有清零和预设功能的双通道 J-K 下降沿触发器

SN74AHC74 具有清零和预设功能的双通道上升沿触发 D 类触发器

SN74HC74-Q1 具有清零和预设功能的汽车类双通道 D 级正边沿触发触发器

SN74HCT374 具有三态输出的八路 D 类边沿触发器

CD74HC73 具有复位功能的高速 CMOS 逻辑双通道下降沿 J-K 触发器

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SN74LVC74A-Q1 汽车类具有清零和预设功能的双通道上升沿 D 级触发器

SN74LS273是一款8位上升沿触发D型触发器。该电路具有时钟(CP)和主复位(MR)输入端。输出端Qn会输出相对应的Dn的状态,满足从低到高时钟(CP)转换的建立和保持时间要求。MR为低电平时，输出变为低电平，与时钟和数据输入无关。输入内置钳位二极管。这样就可以使用限流电阻将输入接口连接到超过Vcc的电压。

74LVC377是一款八进制正边沿触发D型触发器。该器件具有时钟（CP）和数据使能（E）输入。当E为低电平时，输出Qn将呈现其相应D输入的状态，这些D输入需满足时钟（CP）从低到高转换时的建立时间和保持时间要求

SN74LVC112A 具有清零和预设功能的双路下降沿 J-K 触发器

MC74HC112A的引脚排列与LS112相同。该器件的输入与标准CMOS输出兼容；通过上拉电阻，可与LSTTL输出兼容。每个触发器采用负边沿时钟触发，并具有低电平有效的异步置位和复位输入

74LVC1G79 是一款单路正边沿触发 D 型触发器。在时钟信号由低电平向高电平转换时，D 输入端的数据若满足建立时间和保持时间要求，将被存储在触发器中，并出现在 Q 输出端。输入信号可由 3.3 V 或 5 V 器件驱动

HEF4013 是一款双 D 型触发器，具有独立的直接置位输入（SD）、直接清零输入（CD）、时钟输入（CP）和输出（Q、Q̅）。当 CP 为低电平时，数据被接收，并在时钟信号的上升沿传输至输出端。高电平有效的异步 CD 和 SD 输入相互独立，且优先于 D 或 CP 输入

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CD4013B 是一双 D 触发器，由两个相同的、相互独立的数据型触发器构成，每个触发器有独立的数据、置位(SD)、复位(CD)、时钟输入(CP)和 Q 及 Q 块输出，此器件可用作移位寄存器，且通过将 Q 输出连接到数据输入，可用作计算器和触发器。在时钟上升沿触发时，加在 D 输入端的逻辑电平传送到 Q 输出端。置位和复位与时钟无关，而分别由置位或复位线上的高电平完成。CD4013B 工作电压 VDD 推荐使用在 5V 到 15V 之间。输入端口必须接 VDD 或 VSS 或者其他输入脚。

SN74HC/HCT74是双路上升沿触发的D型触发器。它们具有单独的数据（nD），时钟（nCP），置数（nSD）和复位（nRD）输入以及互补的nQ和nQ输出。满足从低电平到高电平时钟转换的建立和保持时间要求的nD输入处的数据存储在触发器中，并出现在nQ输出中。