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TMS320C6713B C67x 浮点 DSP- 高达 300MHz、McBSP、16 位 EMIFA

TMS320C6727B C67x 浮点 DSP- 高达 350MHz、McASP、32 位 EMIFA

双核SHARC+DSP（带384KBL1）、1MB共用的L2、176-LQFP

TMS320C6413 C64x 定点 DSP - 500MHz、McBSP、McASP、I2cC

是SIMD SHARC系列DSP的一员，具有超级哈佛架构。这些处理器与ADSP-2126x和ADSP-2116x DSP以及第一代ADSP-2106x SHARC处理器在单指令单数据（SISD）模式下源代码兼容。是32位/40位浮点处理器，针对高性能汽车音频应用进行了优化，拥有大量片上SRAM、掩模可编程ROM、多个内部总线以消除I/O瓶颈，以及创新的数字应用接口（DAI）。该处理器使用两个计算单元，在一系列DSP算法上比以前的SHARC处理器有显著的性能提升

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特性：16位宽数据路径。 代码高效（C和汇编）架构。 40位宽累加器。 单周期（MAC/MPY），双数据提取。 单周期混合符号乘法：32位乘法支持。 快速六周期除法。 零开销循环。 四个PWM对

特性：16位宽数据路径。 代码高效（C和汇编）架构。 40位宽累加器。 单周期（MAC/MPY），双数据提取。 单周期混合符号乘法：32位乘法支持。 快速六周期除法。 零开销循环。 四个PWM对

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特性：16位宽数据路径。 代码高效（C和汇编）架构。 40位宽累加器。 单周期（MAC/MPY），双数据提取。 单周期混合符号乘法：32位乘法支持。 快速六周期除法。 零开销循环。 四个PWM对

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特性：128-256 Kbytes带ECC的程序闪存和16-32K数据RAM。 快速6周期除法。 代码高效（C和汇编）架构。 40位宽累加器，单周期（MAC / MPY），双数据提取。 单周期，混合符号乘法，外加硬件除法。 32位乘法支持。 五组中断上下文选择寄存器，实现快速中断响应。 零开销循环

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