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具有11个输出并支持JESD204B/JESD204C协议的超低抖动、4.5GHz时钟分配器

NB6L11M 是一款差分 1:2 CML 扇出缓冲器。差分输入结合了通过 VT 引脚访问的内部 50 Ω 端接电阻,接受 LVPECL、LVCMOS、LVTTL、CML 或 LVDS 逻辑电平。仅为此器件提供 VREFAC 引脚,即内部产生的供应电压。VREFAC 用作单端 PECL 或 NECL 输入的参考电压。对于单端输入情况,未使用的互补差分输入将作为开关参考电压联接 VREFAC。VREFAC 还可将电容器耦合输入重偏置。使用时,通过 0.01 ?F 电容器对 VREFAC 进行去耦合,并将源/汲电流限制为 0.5 mA。不使用时,VREFAC 输出应保持开路。该器件采用小型 3x3 mm 16 引脚 QFN 封装。NB6L11M 属于一款 ECLinPS MAX 系列高性能时钟产品。

NB7L14 是一款差分 1:4 LVPECL 扇出缓冲器。NB7L14 会对最高以 7 GHz 或 10.7 Gb/s 运行的时钟或数据复制四个相同的 LVPECL 输出副本。因此,NB7L14 适用于 SONET、GigE、光纤信道、背面电极和其他时钟或数据分发应用。差分输入结合了内部 50 Ω 端接电阻,可通过 VT 引脚访问。此功能让 NB7L14 能够接受多种逻辑标准,如 LVPECL、CML、LVDS、LVCMOS 或 LVTTL 逻辑电平。VREFAC 参比输出可用于重新偏置电容器耦合的差分和单端输入信号。1:4 扇出设计适用于低输出歪曲率应用。

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MC100EP210S 是一款低歪曲率 1:5 双路差分驱动器,在设计时考虑到了 LVDS 时钟分配。LVDS 或 LVPECL 输入信号为差分信号,并且信号被分配为五个相同的差分 LVDS 输出。EP210S 可特别保证低输出-输出歪曲率。优化的设计、布局和处理最大程度降低了器件内和器件到器件的歪曲率。整个输入提供两个内部 50 欧姆电阻。对于 LVDS 输入,应断开 VTA 和 VTB 引脚的连接。对于 LVPECL 输入,应将 VTA 和 VTB 引脚连接至 VTT(VCC-2.0 V)电源。设计人员可充分利用 EP210S 的性能,在底板或主板上分配低歪曲率 LVDS 时钟。在无信号条件下,应对差分输入进行特别考虑以防止不稳定。

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1.2GHz时钟分配IC、2路1.6GHz输入、分频器、延迟调整、5路输出

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