Clestek · 电子元器件型号库
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体声波(BAW)是一种微谐振器技术,能够将高精度BAW谐振器直接集成到具有超低抖动时钟电路的封装中。与其他硅基制造工艺一样,BAW完全由工厂设计和制造。器件是一款超低抖动固定频率振荡器,融合了BAW作为谐振器源。该器件根据特定运行模式进行出厂编程,包括频率、电压、输出类型和功能引脚。带有高性能分数分频器,能够产生指定范围内的任何频率,提供可满足所有频率需求的单个器件系列。凭借高性能时钟、机械稳定性、灵活性和小型封装选项,此器件非常适用于电信、数据以及企业网络和工业应用中使用的高速SERDES内的参考时钟和核心时钟。
双通道、整数N分频0.5GHz/3.0GHzPLL
PLL1708 4.096MHz 至 36.864MHz、串行控制、3.3V 双路 PLL 多时钟发生器
CDCE949-Q1 具有 2.5V 或 3.3V LVCMOS 输出的 AEC-Q100 可编程 4-PLL VCXO 时钟合成器
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是一款可编程时钟发生器,适用于高性能消费、网络、工业、计算和数据通信应用。该设备包含一个内部晶体,无需外部晶体和负载电容调谐。两个选择引脚允许对多达四种不同配置进行编程,可用于不同的操作模式(全功能、部分功能、部分掉电)、区域标准(美国、日本、欧洲)或系统生产裕度测试。可配置为使用两个I2C地址之一,以允许在系统中使用多个设备。
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频率合成器可用于实现无线接收器和发射器的上变频和下变频部分中的本地振荡器。它由低噪声数字PFD(相位频率检测器)、精密电荷泵、可编程参考分频器、可编程A和B计数器以及双模预分频器 (P / P + 1) 组成。A(6位)和B(13位)计数器与双模预分频器 (P / P + 1) 一起实现N分频器 (N = BP + A)。此外,14位参考计数器(R计数器)允许在PFD输入处选择REF_IN频率。如果合成器与外部环路滤波器和VCO(压控振荡器)一起使用,则可以实现完整的PLL(锁相环)。其非常高的带宽意味着在许多高频系统中可以消除倍频器,简化系统架构并降低成本。
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是一款可编程时钟发生器,适用于高性能数据通信、电信、消费和网络应用。有三个内部PLL,每个均可单独编程,允许从单个参考时钟生成三个独特的非整数相关频率。参考时钟可来自两个冗余时钟输入之一,具有无毛刺自动或手动切换功能。可通过I2C或JTAG接口编程,内部EEPROM允许用户保存和恢复设备配置
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提供多输出时钟发生器功能,包含一个为以太网和千兆以太网线卡应用优化的专用锁相环 (PLL) 核心。整数 N PLL 设计基于高性能、低抖动频率合成器的可靠产品组合,以最大化网络性能。也适用于其他需要低相位噪声和抖动性能的应用。配置特定应用只需将外部上拉或下拉电阻连接到适当的引脚程序读取器引脚 (PPRx)
是一款集成的整数 N 合成器和压控振荡器 (VCO)。外部电感设置中心频率,可实现 65 MHz 至 400 MHz 的 VCO 频率范围。一个额外的分频级允许对 VCO 信号进行分频,CMOS 电平输出等效于 VCO 信号除以 2 至 31 之间的整数值,若需要,该分频信号可进一步除以 2。通过简单的三线接口控制所有片上寄存器。该器件在 3.0 V 至 3.6 V 的电源下工作,不使用时可断电。
LMX2572LP 采用 FSK 调制的 2GHz 低功耗宽带射频合成器
NB3H5150 是一款高性能多速率时钟生长期,可使用 25 MHz 输入参考,基于单个 PLL 同时合成最多四个不同的频率。参考频率可由晶体、LVCMOS/LVTTL、LVPECL、HCSL 或 LVDS 差分信号。REFMODE 引脚选择参考源。三个输出组(CLK1A/CLK1B 至 CLK3A/CLK3B)产生用户可选择的频率: 25 MHz、33.33 MHz、50 MHz、100 MHz、125 MHz 或 156.25 MHz,并且具有小于 0.3 ps 的超低噪声/抖动性能。第四个输出组 (CLK4A/CLK4B) 可在引脚搭接模式下产生以下整数和 FRAC?N 频率: 33.33 MHz、66.66 MHz、100 MHz、106.25 MHz、125 MHz、133.33 MHz、155.52 MHz、156.25 MHz 或 161.1328 MHz。通过 I2C 接口可提供更多可编程频率,且具有不到 1 ps 的抖动性能。在将来的应用说明中会提供详细的注册说明。每个输出块可创建两个单端相内 LVCMOS 输出或一个 LVPECL 输出差分对。在四个输出块中,每个均可通过单独的 VDDO、用于 LVPECL 的 2.5 V/3.3 V、用于 LVCMOS 的 1.8 V/2.5 V/3.3 V 单独供电。串行(I2C 和 SMBUS)接口可编程多种功能,包括每个分频器块的频率和输出电平,并且每个块均可单独启用和禁用。
是基于锁相环(PLL)的时钟转换器,旨在满足有线通信和基站应用的需求。采用整数N PLL以适应适用的频率转换要求。接受单端输入参考信号。引脚可编程,可提供从15种可能的输入频率到52种可能的输出频率对(OUT1和OUT2)的标准输入/输出频率转换矩阵。输出与LVPECL、LVDS或单端CMOS逻辑电平兼容,采用严格的CMOS工艺实现。工作温度范围为 -40°C至 +85°C。
LMK04208 具有 6 个可编程输出的超低噪声时钟抖动消除器
我们可以协助查找停产料替代方案，也可以按功能参数反向选型。