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延迟线有五个等间距抽头,提供4ns至500ns的延迟。采用表面贴装封装,节省PCB面积。结合100%硅延迟线和行业标准μMAX及SO封装,实现了低成本和优于混合技术的可靠性。在固定延迟后,能在输出端重现输入逻辑状态,设计用于以相同精度重现上升沿和下降沿。每个抽头可驱动多达10个74LS负载。

5.0V、8位可编程延时电路、 在大屏幕LCDTV中可理想用于行同步(HSYNC)脉冲的延时,达到更高的显示分辨率

是3.3V版本,可在3.0V至3.6V范围内工作。系列延迟线有五个等间距抽头,提供4ns至500ns的延迟。采用表面贴装封装以节省PCB面积。通过100%硅延迟线和行业标准μMAX和SO封装的组合,实现了低成本和优于混合技术的卓越可靠性。5抽头硅延迟线在经过由部件编号破折号后的扩展指定的固定延迟后,在输出端重现输入逻辑状态。设计用于以相同精度重现上升沿和下降沿。每个抽头能够驱动多达10个74LS负载。

是一种可编程延迟线,使用数字控制信号对输入信号进行延迟。延迟可以从3.2ns到14.8ns以10ps为增量变化。此外,通过设置FTUNE引脚的电压,延迟可以在约40ps的范围内连续变化。输入信号为LVPECL,使用2.5V±5%或3.3V±10%的电源,并在-40°C至+85°C的全工业温度范围内得到保证。延迟根据控制字以离散步骤变化。控制字长度为10位,以10ps为增量控制延迟。第11位是D[10],用于同时级联以获得更大的延迟范围。此外,当输入引脚IN和/IN悬空时,默认等效为低电平状态。此外,为了实现最大灵活性,控制寄存器接口接受CMOS或TTL电平信号。

可编程延迟线使用数字控制信号对输入信号进行延迟。延迟可以以10ps为增量,从3.2ns变化到14.8ns。此外,输入信号为LVPECL,使用2.5V ± 5%或3.3V ± 10%的电源,并在-40°C至+85°C的全工业温度范围内得到保证。延迟根据控制字以离散步长变化。控制字长度为10位,以10ps为增量控制延迟。第11位是D[10],用于同时级联以实现更大的延迟范围。此外,输入引脚IN和/IN在悬空时默认等效为低电平状态。此外,为了实现最大灵活性,控制寄存器接口接受CMOS或TTL电平信号。对于需要模拟延迟输入的应用,请参考SY89296L,它是一款具有微调控制的可编程延迟芯片。

NB6L295 是一款双沟道可编程延迟芯片,主要适用于时钟或数据去摆和计时调节. NB6L295 功能多样,两个单独的可变延迟沟道 PD0 和 PD1 可配置为两种运行模式之一,双延迟或扩展延迟。在双延迟模式下,每个沟道均具有一个可编程延迟部分,设计为使用门极矩阵和多路复用器链条。每个沟道具有固定最小延迟 3.2 ns。扩展延迟模式相当于 PD0 和 PD1 的相加延迟,并且通过将串行数据接口 MSEL 位设置为高电平来实现。这样会将 PD0 输出内部级联到 PD1 的输入中。因此,扩展延迟路径在 IN0/IN0 输入处开始,流经 PD0,级联到 PD1,然后通过 Q1/Q1 输出。扩展延迟模式具有固定最小延迟 6 ns。通过 3 引脚串行数据接口对每个延迟沟道进行编程可以实现所需延迟,如应用部分描述的那样。这种可数字选择延迟的增量分辨率通常为 11 ps,双延迟模式下的净可编程延迟范围为每沟道 0 ns 至 6 ns;扩展延迟模式为 0 ns 至 11.2 ns。多电平输入可通过差分 LVPECL、LVDS 或 CML 逻辑电平;或单端 LVPECL、LVCMOS 或 LVTTL 直接驱动。一个启用引脚可用于控制两个输入。SDI 输入引脚由 LVCMOS 或 LVTTL 电平信号控制。NB6L295 LVPECL 输出包含温度补偿电路。此器件采用 4 mm x 4 mm 24 引脚 QFN 无铅封装。NB6L295 属于一款 ECLinPS MAX 系列高性能产品。

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延迟线有五个等间距抽头,提供4ns至500ns的延迟。采用表面贴装封装,节省PCB面积。结合100%硅延迟线和行业标准μMAX及SO封装,实现了低成本和优于混合技术的可靠性。在固定延迟后,能在输出端重现输入逻辑状态,设计用于以相同精度重现上升沿和下降沿。每个抽头可驱动多达10个74LS负载。

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是一款可编程延迟模块,延迟范围为 1μs 至 33.6 秒。单个电阻 RSET 对内部主振荡器频率进行编程,设置时间基准。输入到输出的延迟由该主振荡器和一个内部时钟分频器 NDIV 决定,NDIV 可编程为 1 到 221 的八个设置。输出(OUT)在延迟上升和/或下降过渡后跟随输入(IN)。还可以通过单独的控制电压动态调整延迟时间。为便于配置,可使用基于网络的设计工具。

TimerBlox:延迟模块 / 防反跳器

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